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Verilog HDL算法與電路設(shè)計(通信和計算機網(wǎng)絡(luò)典型案例)/電子信息前沿技術(shù)叢書

Verilog HDL算法與電路設(shè)計(通信和計算機網(wǎng)絡(luò)典型案例)/電子信息前沿技術(shù)叢書

定  價:69 元

叢書名:電子信息前沿技術(shù)叢書

        

  • 作者:喬廬峰,陳慶華,晉軍,續(xù)欣,趙彤 編
  • 出版時間:2021/5/1
  • ISBN:9787302568742
  • 出 版 社:清華大學(xué)出版社
  • 中圖法分類:TP312 
  • 頁碼:253
  • 紙張:
  • 版次:1
  • 開本:16開
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本書精選了通信、計算機和網(wǎng)絡(luò)領(lǐng)域9類共20余個典型電路,包括網(wǎng)絡(luò)接口、存儲管理、幀同步、CAM和TCAM、哈希散列查找、深度包檢測、漏桶算法、數(shù)據(jù)交換單元和SM4加解密電路,給出了每個電路的功能說明、算法原理和內(nèi)部結(jié)構(gòu),以及完整的Verilog HDL設(shè)計代碼和仿真測試代碼。本書中的所有代碼都在FPGA開發(fā)環(huán)境上進行了實際驗證,可以直接應(yīng)用于讀者的設(shè)計實踐中,具有良好的參考價值。
本書主要面向具有一定Verilog HDL語法基礎(chǔ),著手進行大規(guī)模數(shù)字系統(tǒng)設(shè)計的電子技術(shù)、計算機、通信和網(wǎng)絡(luò)領(lǐng)域的高年級本科生、研究生和已經(jīng)進入工作崗位的工程技術(shù)人員。
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