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FPGA系統(tǒng)設(shè)計(jì)——基于Verilog HDL的描述(微課視頻版)
本書從基礎(chǔ)到應(yīng)用,全面介紹了FPGA的開發(fā)應(yīng)用知識(shí),包括FPGA開發(fā)簡(jiǎn)介、Verilog HDL硬件描述語言、Quartus Prime設(shè)計(jì)開發(fā)環(huán)境、基本電路的Verilog HDL設(shè)計(jì)、仿真測(cè)試、基于ip核的設(shè)計(jì)、人機(jī)交互接口設(shè)計(jì)、數(shù)字信號(hào)處理、密碼算法設(shè)計(jì)、基于Nios的SOPC系統(tǒng)開發(fā)共10章的內(nèi)容,配合具體的例子進(jìn)行闡述,提供完整的設(shè)計(jì)源程序,力求簡(jiǎn)明易懂。
本書可作為高等學(xué)校自動(dòng)化、電子信息、計(jì)算機(jī)等的本科生教材,也可供從事電子設(shè)計(jì)的工程技術(shù)人員參考。
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